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--- ssis:architettura [04/05/2007 alle 17:34 (19 anni fa)] – Marco Aldinucci
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@@ Linea 38: / Linea 38: @@
     * Sistema di elaborazione come insieme di unità
     * Rappresentazione in base b e albegra di Boole
+  - Seminario 3 (22/03/2007): Reti combinatorie e sequenziali(5 ore)
     * Funzioni e reti Combinatorie, sintesi e ritardi delle reti combinatorie
-  - Seminario 3 (22/03/2007): (5 ore)
+    * Reti Sequenziali sincrone
-    * Reti Sequenziali
     * Macchine di Mealy e Moore
     * Modello di unità di elaborazione: PO e PC
-    * Livello FW: Microlinguaggi TS e PS
+  - Seminario 4 (29/03/2007): Unità di elaborazione (5 ore)
-  - Seminario 4 (29/03/2007): (5 ore)
+    * Interprete HW di specifiche FW: TS e PS
-    * Interprete HW di specifiche FW TS e PS
     * Metodologia di progettazione di PO e PC
     * Semplici esempi di Unità
-    * Architettura del calcolatore general-purpose
+  - Seminario 5 (03/04/2007): Architettura del calcolatore (5 ore)
+    * Sincronizzazione fra unità
+    * Architettura del calcolatore general-purpose come insieme di unità
+    * Memorie
+  - Seminario 6 (06/04/2007): Il linguaggio Assembler 1 (2.5 ore)
     * Linguaggio Assembler
-  - Seminario 5 (03/04/2007): (5 ore)
+    * Modi di indirizzamento
-    * xxx
+  - Seminario 7 (12/04/2007): Il linguaggio Assembler 2 (5 ore)
-  - Seminario 6 (06/04/2007): (2.5 ore)
+    * Classifficazione delle istruzioni
-    * xxx
+    * RISC e CISC
-  - Seminario 7 (12/04/2007): (5 ore)
+    * Compilazione di un semplice linguaggio imperativo in assembler
-    * xxx
+    * Funzioni: Il passaggio di parametri via registro e via memoria
-  - Seminario 8 (19/04/2007): (5 ore)
+  - Seminario 8 (19/04/2007): Le gerarchie di memoria (5 ore)
-    * xxx
+    * Obiettivi, livelli
+    * Blocchi, pagine
+    * Località
+    * Prestazioni
+    * Indirizzamento e traduzione degli indirizzi